Micro Systèmes n°34 septembre 1983
Micro Systèmes n°34 septembre 1983
  • Prix facial : 25 F

  • Parution : n°34 de septembre 1983

  • Périodicité : mensuel

  • Editeur : Société Parisienne d'Edition

  • Format : (203 x 271) mm

  • Nombre de pages : 422

  • Taille du fichier PDF : 325 Mo

  • Dans ce numéro : spécial guide du nouvel utilisateur de micro-ordinateurs.

  • Prix de vente (PDF) : gratuit

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Certaines extensions mémoire possèdent des zones spécialement réservées au code machine. Initiation ment l'adresse du premier octet non-existant au-dessus de la RAM. Sur le ZX-81 de base (1 K RAM), RAMTOP vaut 17408, contre 32768 avec le module 16 K. Si l'on « POKE » une autre valeur (inférieure bien sûr) et si un NEW est aussitôt exécuté, on libère « de force » tous les octets situés entre l'ancienne et la nouvelle RAMTOP. Si l'on omet NEW, la pile machine reste audessus de RAMTOP, et constitue un réel danger pour les octets qui seront logés là. L'espace mémoire ainsi dégagé peut être utilisé à la discrétion du programmeur, mais ne sera pas sauvegardé sur cassette lors de l'exécution d'un SAVE. On utilise principalement cette zone à deux fins  : • ranger temporairement des octets qui seront recopiés ailleurs, plus tard.• accueillir des routines machine déjà contenues, sous une autre forme, dans un programme Basic qui sera effacé une fois son rôle accompli (bien des programmes du commerce se chargent ainsi, rendant difficile leur recopie « pirate » sur une autre cassette !) — Utilisation d'extensions mémoire protégées  : Certaines extensions mémoire (notamment de plus de 16 K octets) possèdent des zones spécialement réservées au code machine  : leur principal avantage est d'être inaltérables par NEW ou même par un éventuel bouton de remise à zéro de l'unité centrale. Les routines qui y sont logées sont donc à l'abri même si la machine se bloque. Cette particularité est inestimable lors de la mise au point, parfois hésitante, de certains programmes machine. Conclusion Il serait tout à fait irréaliste d'espérer tout savoir sur le lan- gage machine du ZX-81 au terme de la lecture de ces pages ! Le gros du travail reste à faire, à savoir l'apprentissage progressif, au moyen d'ouvrages spécialisés, du fonctionnement de toutes les instructions du Z-80. Il nous a cependant semblé souhaitable de faire la lumière sur les particularités d'utilisation du langage Assembleur sur le ZX-81, car ce sont précisément elles qui risquent le plus de dérouter le débutant  : il est de notoriété publique que seul un informaticien chevronné peut se contenter des indications de la notice SIN- CLAIR, et la littérature consacrée au Z-80 ne peut qu'ignorer superbement le ZX-81, qui lui est postérieur de plusieurs années ! Puissions nous être parvenus à faire la liaison entre ces deux mondes si proches et pourtant si différents des microprocesseurs (Z-80) et des micro-ordinateurs (ZX-81)...3 Patrick GUEULLE AU CŒUR DU ZX 81  : LE Z 80 Commercialisé depuis 1976, le Z 80 est l'un des microprocesseurs 8 bits les plus diffusés. Son succès est évidemment directement lié à sa puissance  : 158 instructions de base (696 avec les différents modes d'adressage), double jeu de registres, gestion très performante des interruptions (3 modes), etc. Afin de vous permettre d'élaborer vos programmes en langage machine, voici le tableau des instructions du Z 80 avec leurs correspondances hexadécimales ainsi qu'une description sommaire de sa structure interne. Fig. A. Configuration interne du Z 80. 143E0 RO RESE1 WATT 02111 2/511/PSW 1 5 1'1 log rOln 1 C) [51'1 1'1 1.44 nI C 1-..rsrelion 1/2 remue 2, Sen. F AJ F. H I 1. H I., 1 [. o I., 1 I Inc. 1l.. I. C I [., I. i te o je E ['o" —I [.. SY p W r iK 1 [n n I ix iv 1 INT SUS AC MALI 22 registres Le Z 80 possède au total 22 registres accessibles à l'utilisateur. Parmi ces 22 registres, nous pouvons noter  : deux jeux de registres équivalents contenant chacun un accumulateur, un mot d'état, 6 registres généraux 8 bits (ou 3 X 16 bits). Un seul jeu (ou un accumulateur) étant disponible à la fois, le programmeur choisit de travailler sur l'un d'eux, sachant qu'il peut passer de l'un à l'autre par une instruction d'échange.• Deux accumulateurs A et A'.• Deux « mots d'état » PSW et PSW'. 282 — MICRO-SYSTEMES Septembre 1983
Tableau des instructions du 7.4O R IF Code hexa.• Deux jeux de 6 registres généraux sur 8 bits (ou 3 x 16 bits).• Un compteur ordinal sur 16 bits  : PC.• Un compteur de rafraîchissement sur 7 bits  : R. 11 Instructions Code hexa.• Un registre de pages d'adresses pour les interruptions  : 8 bits (I).• Un pointeur de pile SP sur 16 bits.• Deux registres d'index IX, IY sur 16 bits. La configuration interne du Z 80 apparaît figure A, tandis que les différentes instructions, correspondant à ces ces registres internes, sont résumées par le tableau ci-dessous. g Instructions Code hexa. Instructions Code hexa. Instructions 00 NOP 56 LD D, (HL) D7 RST 10H ED 67 RRD 01 yyyy LD BC, data 16 5 Isss LD E, reg D8 RET C ED 6F RLD 02 LD (BC), A 5E LD E, (HL) D9 EXX ED AO LDI 03 INC BC 6 Osss LD H, reg DAppqq JPC, addr ED Al CPI 04 INC B 66 LD H, (HL) DB yy IN A, (port) ED A2 INI 05 DEC B 6lsss LDL, reg DCppqq CALLC, addr ED A3 OUTI 06 yy LD B, data 6E LDL, (HL) DD 00xx 9 ADD IX,ppED A8 LDD 07 RLCA 7 Osss LD (HL), reg DO 21 yyyy LD IX, data 16 El) A9 CPD 08 EX AF, AF 76 HALT DD 22ppqq LD (addr), IX ED AA I ND 09 ADD HL, BC 7 Isss LD A, reg DI) 23 INC IX ED AB OUTD OA LD A, (BC) 7E LD A, (HL) DI) 2Appqq LD IX, (addr) ED BO LOIR OB DEC BC 8 Orrr ADD A, reg DD 2B DEC IX ED BI CPIR OC INC C 86 ADD A, (HL) DD 34 disp INC (IX + disp) ED B2 INIR OD DEC C 8 Irrr ADC A, reg DD 35 disp DEC (IX + disp) ED B3 OTIR OE yy LDC, data 8E ADC A, (HL) DD 36 disp yy LD (IX + disp), data ED B8 LDDR OF RRCA 9 Orrr SUB reg DD Olddd110 disp LD reg, (IX + disp) ED go CPDR 10 disp-2 DJNZ disp 96 SUB (HL) DD 7 Osss disp LD (IX + disp), reg ED BA I NDR 11 yyyy LD DE, data 16 9 lm SBC A, reg DI) 86 disp ADD A, (IX + disp) ED BB OTDR 12 LD (DE), A 9E SBC A, (HL) DI) 8E disp ADC A, (IX + disp) EE yy XOR data 13 INC DE A Orrr AND reg DD 96 disp SUB (IX + disp) EF RST 28H 14 INC D A6 AND (HL) DD 9E disp SBC A, (IX + disp) FO RET P 15 DEC D A Irrr XOR reg DD A6 disp AND (IX + disp) Fl POP AF 16 yy LD D, data AE XOR (HL) DD AE disp XOR (IX + disp) F2ppqq JP P, addr 17 RLA B Orrr OR reg DI) B6 disp OR (IX + disp) F3 DI 18 disp-2 JR disp B6 OR (HL) DI) BE disp CP (IX + disp) F4ppqq CALL P, addr 19 ADD HL, DE B Irrr CP reg DD CB disp 06 RLC (IX + disp) F5 PUSH AF IA LD A, (DE) BE CP (HL) DD CB disp OE RRC (IX + disp) F6 yy OR data I B DEC DE CO RET NZ DD CB disp 16 RL (IX + disp) F7 RST 30H IC INC E C I POP BC DO CB disp IE RR (IX + disp) F8 RET M ID DEC E C2ppqq JP NZ, addr DD CB disp 26 SLA (IX + disp) F9 LD SP, HL IE yy LD E, data C3ppqq JP addr DD CB disp 2E SRA (IX + disp) FAppqq JPM, addr 1F RRA C4ppqq CALL NZ, addr DD CB disp 3E SRL (IX + disp) FB El 20 disp-2 JR NZ, disp C5 PUSH BC D D CB dispOlbbb110 BIT b, (IX + disp) FCppqq CALLM, addr 21 yyyy LD HL, data 16 C6 yy ADD A, data DD CB disp lObbb110 RES b, (IX + disp) FD 00xx 9 ADD IY,rr 22ppqq LD (addr), HL C7 RST 00H DD CB displ Ibbb110 SET b, (IX + disp) FD 21 yyyy LD IY, data 16 23 INC HL C8 RET Z DI) El POP IX FI) 22ppqq LD (addr), IY 24 INC H i C9 RET DD E3 EX (SP), IX FI) 23 INC IY 25 DEC H CAppqq JP Z, addr DD E5 PUSH IX FD 2Appqq LD IY, (addr) 26 yy LD H, data CB 0 Orrr RLC reg DD E9 JP (IX) FI) 2B DEC IY 27 DAA CB 06 RLC (HL) DD F9 LD SP, IX FI) 34 disp INC (IY + disp) 28 disp-2 JR Z, disp CB 0 Irrr RRC reg DE yy SBC A, data FI) 35 disp DEC (IY + disp) 29 ADD HL, HL CB OE RRC (HL) DF RST 18H FD 36 disp yy LD (1Y + disp), data 2Appqq LD HL, (addr) CB 1 Orrr RL reg E0 RET PO FD Olddd110 disp LD reg, (IY + disp) 2B DEC FIL CB 16 RL (HL) El POP HL FI) 7 Osss disp LD (IY + disp), reg 2C INC L CB I lm RR reg E2ppqq JP PO, addr FI) 86 disp ADD A, (IY + disp) 2D DEC L CB IE RR (HL) F3 EX (SP), HL FD 8E disp ADC A, (1Y + disp) 2E LDL, data CB 2 Orrr SLA reg F4ppqq CALL PO, addr FI) 96 disp SUB OY + disp) 2F CPL CB 26 SLA (HL) ES PUSH HL FD 9E disp SBC A, (IY + disp) 30 disp-2 JR NC, disp CB 2 Irrr SRA reg [6 >y AND data FI) A6 disp AND (IY + disp) 31 yyyy LD SP, data 16 CB 2E SRA (HL) [7 RST 20H FD AE disp XOR (IY + disp) 32 PMI LD (addr), A CB 3 Irrr SRL reg ES RET PE FD B6 disp OR (IY + disp) 33 INC SP CB 3E SRL (HL) [9 JP (ML) FD BE disp CP (IY + disp) 34 INC (HL) CB Olbbbrrr BIT b, reg EAppqq JIP PE, addr FD CB disp 06 RLC (IY + disp) 35 DEC (HL) CB Olbbb110 BIT b, (HL) EB EX DE, HL FI) CB disp OE RRC (IY + disp) 36 y y LD (HL), data CB lObbbrrr RES b, reg ECppqq CALL PE, addr FI) CB disp 16 RL (IY + disp) 37 SCF CB lObbb110 RES b, (HL) ED Otddd000 IN reg, (C) FI) CB disp IE RR (IY + disp) 38 JRC, disp CB I lbbbrrr SET b, reg ED Olsss001 OUT (C), reg FD CB disp 26 SLA (IY + disp) 39 ADD HL, SP CB lIbbb110 SET b, (HL) ED Olxx 2 SBC HL,rp FI) CB disp 2E SRA (IY + disp) 3Appqq LD A, (addr) CCppqq CALL Z, addr ED Olxx 3ppqq LD (addr),rp FD CB disp 3E SRL (IY + disp) 3B DEC SP CDppqq CALL addr ED 44 NEG FD CB dispOlbbb110 BIT b, (IY + disp) 3C INC A CE yy ADC A, data ED 45 RETN FD CB displ0bbb110 RES b, (IY + disp) 3D DEC A CF RST 08H FD OlOnn110 IM m FD CB displ Ibbb110 SET b, (IY + disp) 3E y> LD A, data DO RET NC ED 47 LD I, A FD El POP IY 3F CCF DI POP DE [D Olxx A ADC HL,rp FD E3 EX (SP), IY 4 Oss, LD B, reg D2ppqq JP NC, addr ED Olxx Bppqq LDrp, (addr) FI) E5 PUSH IY 46 LD B, (HL) D3 yy OUT (port), A E D 41) RETI FD E9 JP (IY) 4 Isss LDC, reg D4ppqq CALL NC, addr ED 4F LD R, A FD F9 LD SP, IY 4E LDC, (HL) D5 PUSH DE F D 57 LD A. FE yy CP data 5 Osas LD D, reg 136 yy SUB data FD 5F LD A, R FF RST 38H Septembre 1983 MICRO-SYSTEMES —283

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